HC705RC16GRSSLASHD datasheet(7/120 Pages) NXP

7 / 120 page

Table of Contents

MC68HC705RC16 — Rev. 3.0

General Release Specification

Table of Contents

5.5

Internal Resets . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46

5.5.1

Power-On Reset (POR). . . . . . . . . . . . . . . . . . . . . . . . . . . .46

5.5.2

Computer Operating Properly Reset (COPR) . . . . . . . . . . .47

5.5.2.1

Resetting the COP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .47

5.5.2.2

COP During Wait Mode . . . . . . . . . . . . . . . . . . . . . . . . . .47

5.5.2.3

COP During Stop Mode . . . . . . . . . . . . . . . . . . . . . . . . . .47

5.5.2.4

COP Watchdog Timer Considerations . . . . . . . . . . . . . . .48

5.5.2.5

COP Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49

5.5.3

Illegal Address. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .49

Section 6. Low-Power Modes

6.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .51

6.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .51

6.3

Stop Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .51

6.4

Stop Recovery . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .52

6.5

Wait Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .52

6.6

Low-Power Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

Section 7. Parallel Input/Output (I/O)

7.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .55

7.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .55

7.3

Port A . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .55

7.4

Port B . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56

7.5

Port C . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .56

7.6

Input/Output Programming . . . . . . . . . . . . . . . . . . . . . . . . . . . .57

Section 8. Core Timer

8.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .59

8.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .59

8.3

Core Timer Control and Status Register. . . . . . . . . . . . . . . . . .61

Freescale Semiconductor, Inc.

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HC705RC16GRS/D Datasheet(PDF) 7 Page - NXP Semiconductors

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