PD70F3559 datasheet(8/85 Pages) RENESAS

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R01DS0142ED0100

Data Sheet

Chapter 6

I/O specification . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

6.1

Port Characteristics

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

6.1.1

Condition settings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

6.1.2

PgE0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

6.1.3

PgE1 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

6.1.4

PgB0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

6.1.5

PgA0 and PgA1. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

Chapter 7

Peripherals specification. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

7.1

Reset timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

7.2

NMI timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

7.3

INTP timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

7.4

FLMD0 timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

7.5

_DCUTRST timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

7.6

Timer timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

7.7

Multiplexed bus timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

7.7.1

MEMC0CLK asynchronous timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

7.7.2

MEMC0CLK synchronous timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

7.8

CSI timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

7.8.1

Master modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

7.8.2

Slave mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

7.9

UART timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

7.10

FCN timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58

7.11

FlexRay timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59

7.12

IIC timing

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

7.13

Frequency Output Function (FOUT)

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

7.14

VLVI characteristics

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

7.15

Voltage comparator characteristics

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64

7.16

LVI characteristics

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

7.17

A/D Converter characteristics

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66

7.17.1

12bit A/D (for ADC channels without S/H functionality) . . . . . . . . . . . . . . . . 66

7.17.2

12bit A/D (For channel ADCA0I0-5 when the S/H function is not used) . . . . 67

7.17.3

12bit A/D (When channel S/H function is used) . . . . . . . . . . . . . . . . . . . . . . 68

7.17.4

10bit A/D (for ADC channels without S/H functionality) . . . . . . . . . . . . . . . . 69

7.17.5

10bit A/D (For channel ADCA0I0-5 when the S/H function is not used) . . . . 70

7.17.6

10bit A/D (When channel S/H function is used) . . . . . . . . . . . . . . . . . . . . . . 71

7.17.7

Equivalent circuit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

7.17.8

ADTRG timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

7.18

Key Return

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

Chapter 8

Memory specification. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

8.1

Code flash specification

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

8.2

Data flash specification

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

8.3

Serial write operation specification

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

Chapter 9

Pinning and package specification . . . . . . . . . . . . . . . . . . 75

9.1

Pinning specification

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

9.2

Package specification

. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

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