HC705E5GRSSLASHD datasheet(6/148 Pages) NXP

6 / 148 page

Table of Contents

General Release Specification

MC68HC705E5 — Rev. 1.0

Table of Contents

Section 3. Central Processing Unit (CPU)

3.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29

3.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29

3.3

Accumulator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30

3.4

Index Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30

3.5

Condition Code Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . .31

3.6

Stack Pointer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .32

3.7

Program Counter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .32

Section 4. Interrupts

4.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33

4.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .33

4.3

Hardware Controlled Interrupt Sequence . . . . . . . . . . . . . . . . .35

4.4

Software Interrupt (SWI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35

4.5

External Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .36

4.6

Timer Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .36

4.7

Custom Periodic Interrupt (CPI) . . . . . . . . . . . . . . . . . . . . . . . .39

4.8

Synchronous Serial Interface Interrupt (SSI) . . . . . . . . . . . . . .40

4.9

M-Bus (I2C) Interrupt (M Bus) . . . . . . . . . . . . . . . . . . . . . . . . .40

4.10

Operation During Stop Mode . . . . . . . . . . . . . . . . . . . . . . . . . .40

4.11

Operation During Wait Mode . . . . . . . . . . . . . . . . . . . . . . . . . .40

Section 5. Resets

5.1

Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41

5.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41

5.3

External Reset (RESET). . . . . . . . . . . . . . . . . . . . . . . . . . . . . .42

5.4

Internal Resets . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .44

5.5

Power-On Reset (POR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .44

5.6

Computer Operating Properly Reset (COPR). . . . . . . . . . . . . .45

5.6.1

Resetting the COP . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .45

5.6.2

COP During Wait Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . .45

5.6.3

COP During Stop Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . .45

5.6.4

COP Watchdog Timer Considerations . . . . . . . . . . . . . . . .46

5.7

Illegal Address Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .46

Freescale Semiconductor, Inc.

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HC705E5GRS/D Datasheet(PDF) 6 Page - NXP Semiconductors

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